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Video Codec HW IP RTL 설계 및 검증 경력직

수시 채용설계·R&D경력

수시 채용

AI 요약

칩스앤미디어 서울연구소에서 Video Codec 및 영상 입출력 관련 HW IP 설계를 담당하는 RTL 엔지니어를 채용합니다. Macro/Micro Architecture 설계부터 RTL 구현, Testbench 개발, 기능 검증까지 전 과정을 수행합니다. Verilog/SystemVerilog/Python 기반 설계 및 검증 역량이 필수이며, ASIC/SoC/FPGA 설계 플로우 이해가 요구됩니다. Video Codec 표준 이해 및 AI Tool 활용 경험자를 우대합니다.

주요 업무

Video Codec Standard 및 Video 입출력 관련 Specification/Algorithm 분석
HW IP 구현을 위한 Macro/Micro Architecture 설계 및 Control Flow 정의
RTL(Module), Testbench, Script 개발 및 검증 수행
기능 검증 및 Debug, 성능 최적화 (Performance / Power / Bandwidth / Area)

자격 요건

Verilog / SystemVerilog / Python 기반 설계 및 검증, Debug 능력
C 코드 이해 및 수정 가능
HW ASIC IP / SoC / FPGA 설계 Flow 및 EDA Tool에 대한 이해

우대 사항

Video Codec Standard에 대한 이해
AI Tool을 활용한 HW 설계/검증 경험

기술 스택 / 관련 분야

RTLVerilogSystemVerilogPythonASICSoCFPGAEDA

전직 대기업 인사담당자가 24시간 내에 자소서 피드백을 제공합니다무료로 피드백 받아보기24시간 내 피드백 제공

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